实验1+1位全加器设计

实验1 一位全加器设计【实验目的】1. 掌握数字电路的两种设计方法2. 掌握在Cadence中绘制原理图的方法3. 掌握芯片外围特性与实现硬件电路4. 掌握Verilog HDL设计电路的方法。【实验