组合电路的VHDL设计
- 3.3 四选一多路选择器及其VHDL描述 - 3.3.1 四选一多路选择器及CASE语句表述方式a、b、c、d:输入端口s1、s0:通道选择控制信号y: 输出端口
组合电路的VHDL设计