腾讯文库搜索-vhdl八位乘法器资料
vhdl语言4位十进制计数器、4位锁存器、测频控制器的设计
电 子 设 计 自 动 化 实 验 实验名称 综合性实验二、硬件描述语言的层次化设计 实验设备 〔1〕EDA实验箱(型号 ),〔2〕计算机,〔3〕EDA软件〔QuartusII〕实验目的 1、
基于vhdl 的万年历设计
实验报告基 于 VHDL 的 万 年 历 设 计 一:实验目的、设计具有如下功能的万年历: (1)能进行正常的年、月、日和时、分、秒的日期和时间计时功能,按键KEY1用来进行模式切换,当KEY1=
基于VHDL语言在FIR滤波器设计_毕业设计
基于VHDL语言在FIR滤波器设计目 录 TOC \o "1-3" \h \z \u HYPERLINK \l "_Toc292881150" 1绪 论 PAGEREF _Toc29288115
基于VHDL的(7,4)汉明码编解码器的设计
(7,4)汉明码编解码器的设计序言VHDL语言具有功能强大的语言结构,可用明确的代码描述复杂的控制逻辑设计,并且具有多层次的设计描述功能,支持设计库和可重复使用的元件的生成。近几十年来,EDA技术获得
基于VHDL篮球计时器课程设计
EDA技术课程设计课题:篮球竞赛30秒计时器设计系 别: 电气与电子工程系专 业: 电子信息工程姓 名: 朱亚辉学 号: 123408155指导教师: 梁成武河南城建
VHDL的语法要素EDA
- 第4讲 VHDL的语法要素 - 4.1 VHDL的词法元素4.2 VHDL的数据对象4.3 VHDL的数据类型4.4 VHDL的操作符
VHDL数字时钟实验报告新版资料
VHDL数字时钟设计一、试验目标: 深入练习VHDL语言设计工程建立和仿真步骤和方法、熟悉VHDL语言基础设计实体编写方法。同时,在已经有知识基础上,简单综合编写程序,仿制简单器械。二、试验环境
用VHDL设计多功能信号发生器
实验二 用VHDL设计多功能信号发生器一、实验目的1掌握运用quartusⅡ软件仿真2,熟练运用VHDL语言编程二、实验要求 基于《VHDL语言》,通过给定的仪器(EDA6000试验
VHDL实验报告
VHDL实验报告 专用集成电路实验报告 1 1 3 05 0 Z01 1 1 305 024237 刘德文 实验一 开发平台软件安装与认知实验 实验内容 1 1 、 本实验以三线八线译码器
VHDL基础实体结构体
- VHDL基础实体、结构体 - 目录 - contents - VHDL基础概念VHDL实体描述VHDL结构体描述VHDL的
基于VHDL的数字时钟课程设计
数字时钟设计1.设计要求(1)能显示周、时、分、秒,精确到0.1秒(2)可自行设置时间(3)可设置闹铃,并且对闹铃时间长短可控制2.设计分析 (1)根据题目要求可分解为正常计时、时间设置和闹铃设置三大
《VHDL语法基础》课件
- 《VHDL语法基础》PPT课件 - VHDL简介VHDL基本语法元素VHDL程序结构VHDL描述风格VHDL设计实例VHDL高级特性 - con