腾讯文库搜索-VHDL设计初步
七人表决器的VHDL程序设计
一、题目 用VHDL设计七人表决器二、分析讨论: 七人表决器这一功能用C语言、汇编语言或VHDL编程然后下载到单片机上实现,不过用VHDL编程不仅技术含量高而且能让我们更熟练的掌握使用
1用VHDL设计的一位二进制全加器的示例程序
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VHDL语言正弦波信号发生器设计
AS正弦波信号发生器设计一、实验内容1.设计一正弦信号发生器,采用ROM进行一个周期数据存储,并通过地址发生器产生正弦信号。(ROM:6位地址8位数据;要求使用两种方法:VHDL编程和LPM)2.正弦
数字逻辑设计与VHDL描述
数字逻辑设计与VHDL描述 -数字逻辑设计与VHDL描述第一章 逻辑代数基础1.1数制和码制 进位计数制进位制:逢基数进一数符递增达到基数后高位增一,低位复0数字形式的主要元素是数符和数位
EDA设计课程设计基于VHDL的简易全自动控制洗衣机
广州大学松田学院课 程 设 计 说 明 书 题 目 简易洗衣机的设计 姓 名 专 业 电气工程及其自
基于VHDL的数字时钟设计
目 录 TOC \o "1-2" \h \z \u HYPERLINK \l "_Toc" 1 概述 PAGEREF _Toc \h 1 HYPERLINK \l "_Toc" 1.1数字时钟的
VHDL课程设计(通信电子专业)
- 《数字系统仿真与VHDL设计》课程设计大纲 - 课程设计所占学时、学分:本设计所占的学时为两周,占2个学分一.本设计的目的和任务本设计的任务是熟悉支持VHDL语言的软件,例如
第六章VHDL设计应用实例
- * - - 速度与资源的折中选择:并行加法器与串行级联 - * - 2、4位并行加法器
频率计系统vhdl语言设计
河南机电高等专科学校《职业技能培训》结课大作业频率计系统设计姓 名: 专业班级: 学 号: 任课教师:
VHDL数字电子钟的设计与实现 2rd模板
VHDL数字电子钟的设计与实现_2rd基于VHDL数字电子钟的设计与实现学生:李丽 指导老师:陈沅涛摘 要:本课程设计完成了数字电子钟的设计,数字电子钟是一种用数字显示秒、分、时的计时装置,由于数字
基于VHDL的交通控制灯设计
福建农林大学计算机与信息学院信息工程类实验报告课程名称: VHDL数字系统设计 TOC \o "1-5" \h \z 姓 名:系: 电子信息工程专 业: 电子信息工程年 级: 2008级学 号:指导教
基于VHDL的卷积码编解码器的设计
长沙理工大学《通信电路EDA》课程项目报告系 别 水利计通系 专 业 通信工程 班 级 通信1003班 指导教师 项目组